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Aplicación práctica

Aplicación práctica

Arrays multicámara a bordo: cómo el FPGA/MPSoC ejecuta inferencia de IA en tiempo real en el edge

Cuando cuatro cámaras en una línea alimentan todas a un servidor central para la detección, el ancho de banda no da abasto y la latencia no se puede comprimir. El mejor camino es hacer la captura, el preprocesado y la inferencia en la propia placa, enviando de vuelta solo los resultados de detección y una vista previa comprimida. Este artículo divide la arquitectura de IA a bordo del edge en roles PS/PL, con el presupuesto de ancho de banda y la ruta de despliegue del modelo.

2026-10-23·Leer más →
Aplicación práctica

Sustitución práctica de ZYNQ por chips chinos: qué cambia al migrar de Xilinx ZYNQ a PBC7Z020G/021G

El diseño original usa Xilinx Zynq-7000 (XC7Z020) para el esquema heterogéneo software ARM + lógica realista en FPGA, y ahora debe pasar a un chip nacional. ¿Supone cambiar el chip reescribir todo el proyecto, o solo cambios locales? Este artículo divide la migración de HWD7Z020 (compatible con XC7Z020) a PBC7Z020G/021G en tres capas —software PS, lógica PL, arranque y BSP— y desglosa el volumen real de cambios, las partes reutilizables y los puntos de riesgo.

2026-10-22·Leer más →
Aplicación práctica

Formación de haces en ultrasonidos médicos: cadena de señal de 128 canales y presupuesto de velocidad de datos

Una sonda de ecografía a color de 128 canales muestra cada canal con un ADC de 12 bits y 40 MS/s, lo que da una velocidad de datos en bruto de unos 7,7 GB/s: un nivel que una CPU no puede absorber, y mucho menos generar imagen en tiempo real. El enfoque correcto es ejecutar primero el beamforming, la detección de envolvente y el submuestreo dentro del FPGA, y entregar al host solo los datos de imagen comprimidos. Este artículo descompone la cadena de 128 canales en etapas, presupuesta la velocidad de datos en cada paso, y explica exactamente qué hace el FPGA en medio.

2026-10-20·Leer más →
Aplicación práctica

Construcción de un frontend SDR de banda ancha: cadena de señal del ADC al FPGA

El núcleo del Software Defined Radio (SDR): digitalizar la señal de RF lo antes posible, y dejar el procesamiento de señal al FPGA. Una cadena típica de frontend SDR de banda ancha es: antena → LNA → mezclador → ADC → FPGA (DDC + FFT + demodulación). A lo largo de esta cadena, el ancho de banda de los transceptores del FPGA, el buffering DDR y la potencia de cálculo del DSP determinan qué ancho de banda instantáneo se puede alcanzar.

2026-10-15·Leer más →
Aplicación práctica

Composición de cuatro canales 1080p a salida 4K: un balance de ancho de banda

Componer cuatro señales de cámara 1080p en una sola salida 4K parece «juntar cuatro imágenes», pero detrás hay un balance de ancho de banda: ancho de banda de entrada, ancho de banda del buffer de fotogramas DDR, ancho de banda del escalador y ancho de banda de salida, cuatro capas apiladas unas sobre otras. Si los cálculos salen mal, aparecen tartamudeos, tearing o sobrecarga de la DDR. Este artículo recorre cada capa desde el reloj de píxel hacia arriba.

2026-10-12·Leer más →
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Inspección visual industrial en tiempo real con FPGA: de las cámaras GigE a la calibración de defectos

# A lo largo de una línea de inspección de defectos en producción, desde los píxeles de la cámara hasta la señal de rechazo, ¿dónde es irremplazable el FPGA? Este artículo calcula primero el presupuesto de ancho de banda de todo el flujo de datos, después desglosa los cuatro roles que desempeña el FPGA en la cadena visual, compara los límites en tiempo real de los algoritmos tradicionales frente al deep learning y, finalmente, ofrece una selección de hardware desplegable a través de un caso real de estación AOI para juntas de soldadura en PCB.

2026-10-08·Leer más →
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Construcción de tarjetas de adquisición de datos de alta velocidad con FPGA: por qué FMC HPC + PCIe x8 es la combinación dorada

Osciloscopios, digitalizadores, radares en fase, radios definidas por software y monitorización de vibraciones de alta velocidad: el núcleo de todos estos sistemas es «muestreo ADC de alta velocidad → empaquetado de datos → transferencia al host para su procesamiento». ¿Por qué este paso debe usar un FPGA y no un MCU, un DSP o una CPU muestreado directamente? ¿Por qué el conector FMC HPC y la interfaz PCIe x8 se han convertido en la combinación dorada de las tarjetas de adquisición de alta velocidad? Este artículo parte de un proyecto real de adquisición a 250 MSPS.

2026-10-07·Leer más →
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Plataforma de trading cuantitativo ultrarrápido en FPGA: cómo el VU13P ejecuta la cadena tick-to-trade en 300 ns

La esencia del trading cuantitativo es completar el bucle de información «llegada de datos de mercado → cálculo de señal → transmisión de orden» en el menor tiempo posible. Este artículo usa la plataforma AMD Virtex UltraScale+ XCVU13P (VU13P) como hilo conductor, explicando por qué encaja con el trading cuantitativo y cómo desplegarla en una cadena de trading de baja latencia entregable.

2026-09-27·Leer más →